Clase 11 - Memoria de datos - Pontificia Universidad...

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Unformatted text preview: Pontificia Universidad Cat´olica de Chile Escuela de Ingenier´ ıa Departamento de Ciencia de la Computaci´on IIC2343 Arquitectura de Computadores Segundo Semestre 2010 Clase 11: Memoria de datos c circlecopyrt Alejandro Echeverr´ ıa 1. Motivaci´on Un computador que cuenta s´ olo con registros para almacenar datos se encuentra severamente limitado en los programas que puede soportar. Para lograr manejar mayor cantidad de datos es necesario extender la arquitectura del computador b´asico con una memoria de datos. 2. Memoria de datos Los registros de pr´oposito general de un computador representan la forma de almacenamiento m´ as simple y con acceso m´ as directo a la unidad de ejecuci´ on. Sin embargo, aunque se puede extender el n´umero de registros, es imposible escalar lo suficiente para permitir manejar cantidades considerables de informaci´ on en un programa. Debido a esto es necesario agregar un componente especial al computador, que permita almacenar y agregar datos que puedan ser variables durante el transcurso del programa. El componente que se utiliza es la memoria de datos , la cual corresponde a una memoria RAM de lectura y escritura. Al igual que la memoria de instrucciones, la memoria de datos se compone de una secuencia de palabras las cuales pueden ser accedidas mediante direcciones esp´ ecificas asociadas a cada una. La diferencia est´ a en que la memoria de datos debe permitir modificar estas palabras, a diferencia de la de instrucciones, donde la informaci´ on de las instrucciones no cambia durante el transcurso del programa. Para esto, la memoria cuenta con una entrada de datos y una se˜nal de control que indica si la memoria est´ a en modo escirtura o lectura. Para integrar la memoria de datos al computador b´asico se requieren tres conexiones de datos: una conexi´ on con la entrada de datos , otra con la salida de datos y otra con la direcci´ on de los datos . Adicionalmente se requiere agregar una nueva se˜nal de control W a la unidad de control, que cuando tome el valor 1 indique que la memoria est´ a en modo escritura (write), y cuando est´ a en 0, en modo lectura. La entrada de datos, al igual que para el caso de los registros ser´ a obtenida de la salida de la ALU; la salida de datos se conectar´a al multiplexor B, para poder ser ocupada como operando en las operaciones de la ALU. La figura 1 muestra el diagrama con la memoria de datos agregad y con estas conexiones realizadas. Se observa que la memoria de datos tiene palabras de 8 bits con lo cual se pueden ocupar directamente para operar con los registros y la ALU. 1 uU¡ ¢ ¢£¤ ¢ ¥ uU¦§¨© ª ª u«¬ ­®©® ¯§© ¢°°±U¦¦ ²³ ª ª ¬§´ ¥ µ¶ £® £· ¸¯¹º ¸¯¹µ ¸¯¹» µ» £¹¼½ £®½ £·½ ¸®º½ ¸·º½ ¸·µ½ ¸¯¹º½ ¸¯¹µ½ ¸¯¹»½ ¸®°°º½ ¾ ª ª ª ¿ £¹¼ ¬§´ ¢ º º ¸®º ¸·º ¸·µ ³¯À©±¯¨ ¤ÀÁ© ¸©®©§¦  à ³ Ä Å ª uU¡ ¥ u¢¬ ­®©® ¯§© ¢°°±U¦¦...
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This note was uploaded on 03/09/2011 for the course INGENIERIA 111 taught by Professor Jorgevera during the Spring '10 term at Pontificia Universidad Católica de Chile.

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